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Quartus中仿真時出現no simulation input file assignment specify
最近學習FPGA，今天出現了一個錯誤提示：no simulation input file assignment specify ...以前沒遇到過的
具體過程是這樣的，今天試驗在各個工程文件中生成功能模塊，然後新建一個工程，調用各個模塊，導致進行仿真時提示了那個錯誤。然後百度了下，確實有些問題：
翻譯成中文就是仿真文件沒有被指定，要仿真的話先要建一個仿真文件: file -> new -> 選擇Other file選項卡 -> Vector Waveform File 。 然後把輸入輸出端口加進去，再設置輸入的信號，保存，就可以仿真了。
如果你之前已經建立過了，就打開assignments->settings->simulator settings
看裏麵的有個文本框 simulation input 裏麵是否為空，為空的話就要找到你所建立的Vector Waveform File 文件，是以*.VMF結尾的，如果沒找到，你又以為你建立了Vector Waveform File ,很可能粗心的你還沒保存Vector Waveform File ,保存了才會在project裏麵找到。
找到之後進行仿真，如果是functional simulation，要做processing>generate functional simulation netlist..不然會出現
Error: Run Generate Functional Simulation Netlist (quartus_map bmg_control --generate_functional_sim_netlist) to generate functional simulation netlist for top level entity bmg_control before running the Simulator (quartus_sim)之類的錯誤。最後在進行仿真，就可以看到波形圖了。
最後更新：2017-04-03 18:52:09